課 程 概 述
Course Description

課程編碼
Course Code
中文課程名稱
Course Name (Chinese)
英文課程名稱
Course Name (English)
總學分數
Credits
總時數
Hours
3105105 積體電路實體設計演算法 Issues Related to Manufacturing and Reliability 3.0 3
中文概述
Chinese Description
介紹VLSI設計流程及技術地圖 基本演算法 分割 平面規劃 擺置、繞線(整體繞線、細部繞線) 時脈及電線/接地繞線 壓縮佈置後最佳化 時序建模及最佳化 訊號/電源完整性 其它和製作及可靠度有關之議題
英文概述
English Description
Design Flow of VLSI and Technology Roadmap Basic Algorithms Partition Floorplanning Placement and Routing (Global Routing, Detail Routing) Interconnection of Clock and Power/Ground Optimization for post-processing Modeling and Optimization of Timing Signal Integrity

備註:

  1. 本資料係由本校各教學單位、教務處課務組、進修部教務組、進修學院教務組及計網中心所共同提供!
  2. 本資料僅供參考,正式資料仍以教務處、進修部、進修學院所公佈之書面資料為準。